54 lines
1.3 KiB
C
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1.3 KiB
C
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/*
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* Copyright 2021 NXP
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* SPDX-License-Identifier: BSD-3-Clause
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*/
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#ifndef PLAT_GPIO_H
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#define PLAT_GPIO_H
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#include <endian.h>
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#include <lib/mmio.h>
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/* GPIO Register offset */
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#define GPIO_SEL_MASK 0x7F
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#define GPIO_BIT_MASK 0x1F
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#define GPDIR_REG_OFFSET 0x0
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#define GPDAT_REG_OFFSET 0x8
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#define GPIO_ID_BASE_ADDR_SHIFT 5U
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#define GPIO_BITS_PER_BASE_REG 32U
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#define GPIO_0 0
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#define GPIO_1 1
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#define GPIO_2 2
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#define GPIO_3 3
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#define GPIO_SUCCESS 0x0
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#define GPIO_FAILURE 0x1
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#ifdef NXP_GPIO_BE
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#define gpio_read32(a) bswap32(mmio_read_32((uintptr_t)(a)))
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#define gpio_write32(a, v) mmio_write_32((uintptr_t)(a), bswap32(v))
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#elif defined(NXP_GPIO_LE)
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#define gpio_read32(a) mmio_read_32((uintptr_t)(a))
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#define gpio_write32(a, v) mmio_write_32((uintptr_t)(a), (v))
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#else
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#error Please define GPIO register endianness
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#endif
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typedef struct {
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uintptr_t gpio1_base_addr;
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uintptr_t gpio2_base_addr;
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uintptr_t gpio3_base_addr;
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uintptr_t gpio4_base_addr;
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} gpio_init_info_t;
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void gpio_init(gpio_init_info_t *gpio_init_data);
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uint32_t *select_gpio_n_bitnum(uint32_t povdd_gpio, uint32_t *bit_num);
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int clr_gpio_bit(uint32_t *gpio_base_addr, uint32_t bit_num);
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int set_gpio_bit(uint32_t *gpio_base_addr, uint32_t bit_num);
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#endif /* PLAT_GPIO_H */
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